香洲区数字芯片-电脑通信电子驱动ic

1. 数据准备。

　　对于 CDN 的 Silicon Ensemble而言后端设计所需的数据主要有是Foundry厂提供的标准单元、宏单元和I/O Pad的库文件，它包括物理库、时序库及网表库，分别以.lef、.tlf和.v的形式给出。前端的芯片设计经过综合后生成的门级网表，具有时序约束和时钟定义的脚本文件和由此产生的.gcf约束文件以及定义电源Pad的DEF（DesignExchange Format）文件。(对synopsys 的Astro 而言，经过综合后生成的门级网表，时序约束文件 SDC是一样的，Pad的定义文件--tdf ， .tf 文件 --technology file， Foundry厂提供的标准单元、宏单元和I/OPad的库文件就与FRAM， CELL view， LM view 形式给出(Milkway 参考库 and DB， LIB file)

　　2. 布局规划。

　　主要是标准单元、I/O Pad和宏单元的布局。I/OPad预先给出了位置，而宏单元则根据时序要求进行摆放，标准单元则是给出了一定的区域由工具自动摆放。布局规划后，液晶电视数字芯片保修期多久，芯片的大小，Core的面积，dsp aic23芯片 数字录音，Row的形式、电源及地线的Ring和Strip都确定下来了。如果必要在自动放置标准单元和宏单元之后，你可以先做一次PNA(power network analysis）--IR drop and EM .

　　3. Placement -自动放置标准单元。

　　布局规划后，宏单元、I/O Pad的位置和放置标准单元的区域都已确定，这些信息SE（SiliconEnsemble）会通过DEF文件传递给(PhysicalCompiler)，PC根据由综合给出的.DB文件获得网表和时序约束信息进行自动放置标准单元，同时进行时序检查和单元放置优化。如果你用的是PC+Astro那你可用write_milkway， read_milkway 传递数据。

瑞特威科技为你讲解数字IC的特点：

01生命周期可长达10年。

数字IC强调的是运算速度与成本比，数字IC设计的目标是在尽量低的成本下达到目标运算速度。设计者必须不断采用更的算法来处理数字信号，或者利用新工艺提高集成度降低成本。因此数字IC的生命周期很短，大约为1年-2年。

02工艺特殊少用CMOS工艺

数字IC多采用CMOS工艺，而模拟IC很少采用CMOS工艺。因为模拟IC通常要输出高电压或者大电流来驱动其他元件，而CMOS工艺的驱动能力很差。此外，模拟IC关键的是低失真和高信噪比，这两者都是在高电压下比较*做到的。而CMOS工艺主要用在5V以下的低电压环境，5v模拟数字芯片，并且持续朝低电压方向发展。

03与元器件关系紧密

对于数字电路来说是没有噪音和失真的，数字电路设计者完全不用考虑这些因素。此外由于工艺技术的限制，模拟电路设计时应尽量少用或不用电阻和电容，特别是高阻值电阻和大容量电容，只有这样才能提高集成度和降低成本。

某些射频IC在电路板的布局也必须考虑在内，而这些是数字IC设计所不用考虑的。因此模拟IC的设计者必须熟悉几乎所有的电子元器件。

9. Dummy Metal的增加。

　　Foundry厂都有对金属密度的规定，使其金属密度不要低于一定的值，以防在芯片制造过程中的刻蚀阶段对连线的金属层过度刻蚀从而降低电路的性能。加入Dummy Metal是为了增加金属的密度。

　　10. DRC和LVS。

　　DRC是对芯片版图中的各层物理图形进行设计规则检查(spacing ，香洲区数字芯片，width)，它也包括天线效应的检查，以确保芯片正常流片。LVS主要是将版图和电路网表进行比较，来保证流片出来的版图电路和实际需要的电路一致。DRC和LVS的检查--EDA工具 Synopsy hercules/ mentor calibre/ CDN Dracula进行的.Astro also include LVS/DRC check commands.

　　11. Tape out。

　　在所有检查和验证都正确无误的情况下把后的版图GDSⅡ文件传递给Foundry厂进行掩膜制造。

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